EMV-konformes Leiterplatten-Design

Analyse der Schaltung, Bauelemente, Leiterplatte und Simulation

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Präsenz
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Präsenz

EMV-konformes Leiterplatten-Design

Die Grundlagen eines EMV-gerechten Leiterplattendesigns werden vermitteln. Praxisbeispiele zeigen, wie ein strukturierter Ansatz zur Erstellung von Schaltplänen angewendet werden kann: 

  • Neue Ansätze einer strukturierten Anschauungsweise für die Erstellung von Stromlaufplänen
  • Simulationsansätzen eine zielführende Leiterplattenentwicklung
  • Beispielen aus der Praxis
  • Grundsätzlichen Problemstellungen des Leiterplattendesigns Lösungsmöglichkeiten
  • High-Speed-Design Signal Integrity, Lagenaufbau und Terminierung

Zum Thema

Durch die immer schneller werdenden Schaltvorgänge in den integrierten Schaltkreisen stellen sie eine Schlüsselkomponente in Bezug auf die EMV dar. Um entsprechende schaltungstechnische Abhilfen zu schaffen, müssen auch die klassischen passiven Bauelemente, wie Widerstand, Spule und Kondensator betrachtet werden. Hier wird mittels Simulationsbeispielen einer Filterentwicklung der Einfluss ihres charakteristischen Verhaltens sowie die Auswirkungen einer mangelhaften und optimierten Filterauslegung aufgezeigt.

Zielsetzung

Im Seminar wird auf die unterschiedlichen Topologien und ihr entsprechendes EMV-Verhalten detailliert eingegangen, um künftig eine Hilfestellung bei der Entwicklung und Schaltungsauswahl zu geben.

Teilnehmerkreis

  • Ingenieure:innen
  • Techniker:innen
  • Layouter:innen 
  • Mitarbeitende aus der Entwicklung für elektronische Baugruppen

Programm

07.10.2025
09:00—09:10
Begrüßung und Vorstellungsrunde
09:10—10:00
Anwendung passiver Bauelemente zur Verbesserung der EMV
10:00—10:20
Kaffeepause
10:20—11:00
Simulationsunterstützte EMV-Analyse
11:00—12:30
EMV auf Leiterplattenebene
12:30—13:30
Gemeinsames Mittagessen
13:30—15:00
Fortsetzung: EMV auf Leiterplattenebene
15:00—15:20
Kaffeepause
15:20—16:10
EMV und Mechanik-Design
16:10—16:30
Abschlussdiskussion
08.10.2025
08:30—10:00
Theoretische Grundlagen zu High-Speed-Design und Signal Integrity (SI)
10:00—10:20
Kaffeepause
10:20—12:00
Fortsetzung: Theoretische Grundlagen zu High-Speed-Design und Signal Integrity (SI)
12:00—12:15
Diskussion und Zusammenfassung
Hinweise

Weitere EMV Seminare finden Sie hier.

Journal
Preise
Präsenz-Teilnahme
1.295,00 €*
Für HDT-Mitglieder
1.185,00 €*

mehrwertsteuerfrei, einschließlich veranstaltungsgebundener digitaler Arbeitsunterlagen sowie Catering und Getränken bei Präsenz-Teilnahme

Ausgewählter Termin
Di. 07.10.2025, 09:00 Uhr —
Mi. 08.10.2025, 12:00 Uhr
Hansa Apart-Hotel Regensburg
Friedenstr. 7
93051 Regensburg
Veranstaltungsnummer: VA25-00938
Ansprechpartner
Organisatorische Fragen:
info@hdt.de
+49 201 1803-1
Fachliche Fragen:
Dipl.-Ing. Bernd Hömberg
b.hoemberg@hdt.de
+49 201 1803-249

Infos zu unseren Veranstaltungen

Auf Wunsch konzipieren wir für Sie auch spezielle Online-Seminare nach Maß sowie virtuelle Inhouse-Seminare für Ihr Unternehmens­team.
Nutzen auch Sie die Sommermonate, um Ihr Wissen an ausgesuchten Veranstaltungsorten aufzufrischen oder sich neue Qualifikationen anzueignen. 

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Teilnehmerdaten
 

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